（1） 快速掌握（本部分是學習verilog的重要部分，配有verilog語法介紹和訓練題目，大部分都包含有視頻。verilog內(nèi)容有很多，但如果是設計的話，我們只用了很少一部分內(nèi)容，明德?lián)P的VERILOG就是學習設計部分，所以才稱之為快速掌握。）
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（2） 設計規(guī)范（本部分講述了MDY的設計規(guī)范，這僅是一般性規(guī)范，規(guī)定了信號命名、時鐘復位和一般性設計規(guī)范，應該來說是很通用的）
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（3） 測試文件（本部分是測試文件的編寫。設計文件和測試文件有很大的不同，設計文件限制性很強，只能用有限的幾種語法；而測試文件很隨意，想怎么用就怎么用。但是測試文件一般是不太關(guān)心的，寫得好寫得不好，也無所謂，能解決問題就行。所以一般公司不會規(guī)范測試文件。測試文件也要掌握一下，本部分首先講了測試文件的構(gòu)成，然后是5個測試文件的進階練習，據(jù)反映還是有一定難度的，愿意挑戰(zhàn)的就來試下。
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1. MIPI視頻拼接
2. SLVS-EC轉(zhuǎn)MIPI接口(IMX472 IMX492)
3. PCIE采集系統(tǒng)
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